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LDS-ATPG: An automatic test pattern generation system for combinational VLSI circuits
Sen Chung Jiang
, Chung Len Lee
, Wen Zen Shen
, Jwu E. Chen
, Ching Ping Wu
電機工程學系
研究成果
:
會議貢獻類型
›
會議論文
›
同行評審
1
引文 斯高帕斯(Scopus)
總覽
指紋
指紋
深入研究「LDS-ATPG: An automatic test pattern generation system for combinational VLSI circuits」主題。共同形成了獨特的指紋。
排序方式
重量
按字母排序
Keyphrases
Test Pattern Generator
100%
Combinational
100%
Generation System
100%
Test Case Generation
100%
VLSI Circuits
100%
Fault Coverage
66%
Fault Simulator
66%
Pattern Generator
66%
Dynamic Compaction
33%
Pseudo-random Pattern
33%
Deterministic Test
33%
Linear Feedback Shift Register
33%
ATG System
33%
Engineering
Pattern Generator
100%
VLSI Circuits
100%
Generation System
100%
Automatic Test Pattern Generation
100%
Shift Register
20%
Dynamic Compaction
20%
Mathematics
Test Set
100%
Random Pattern
100%
Runtime Systems
100%
Linear Feedback Shift Register
100%
Computer Science
Fault Coverage
100%
Generation System
100%
Random Pattern
50%
linear-feedback shift register
50%
Automatic Text Generation
50%
Runtime Systems
50%